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Sobre la caché del AMD Phenom II[editar]
Yo fue quien traduje este artículo, a partir de la versión en inglés del mismo, haciéndole a la vez algunos pequeños agregados.
De hecho, las memorias caché (o cache) sí se direccionan (ya se trate de las del tipo L1, L2 o L3). No obstante es importante destacar que es el propio microprocesador el que dinámicamente lo hace, a partir de su propia circuitería o firmware de control (tan sólo unas muy pocas CPUs, como algunos modelos relativamente modernos de VIA Cyrix, permiten a los programadores especializados acceder a una parte específica de ella). En este sentido, las cachés se diferencian de las RAM, las que son direccionadas por el sistema operativo a partir de la ejecución de un programa (Y eventualmente también por éstos últimos). En el caso de los lenguajes de programación “visuales” actuales, éstos usualmente sólo permiten direccionar la RAM indirectamente, en un modo conocido como safe (“seguro”).
Naturalmente, para acceder a una porción determinada de cualquier caché, primero ésta debe ser direccionada (De la misma manera que cuando uno visita a un conocido o amigo, primero debe saber que éste vive en la calle X número Y (y eventualmente en el departamento Z). Nota por otro lado que yo había escrito originalmente “accesible y direccionable” cuando, en todo caso, debería haber invertido ambos términos (ya que el addressing de la memoria debe necesariamente anteceder al acceso efectivo de la misma).
Aunque -a partir de tu edición al artículo- reconozco que el uso de aquel término en cuestión puede prestarse a confusión, por lo que tal vez lo mejor sea dejarlo como tú lo dejaste.
No, no estabas “tan equivocado”, ni mucho menos. Gracias por haber atraído mi atención sobre esta ambigüedad. Un cordial saludo a la distancia, desde la ciudad argentina de Bahía Blanca :-)